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Der Umwelt zuliebe
Logic Synthesis and Verification Algorithms
Gary D. Hachtel (Taschenbuch, Englisch)
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Beschreibung
This book blends mathematical foundations and algorithmic developments with circuit design issues. Each new technique is presented in the context of its application to design. Through the study of optimal two-level and multilevel combinational circuit design, the reader is introduced to basic concepts, such as Boolean algebras, local search, and algebraic factorization. Similarly, through the Dieses Produkt haben wir gerade leider nicht auf Lager.
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Technische Daten
Erscheinungsdatum
10.02.2006
Sprache
Englisch
EAN
9780387310046, 9780387310046
Herausgeber
Springer US
Sonderedition
Nein
Autor
Gary D. Hachtel
Seitenanzahl
564
Auflage
1996
Einbandart
Taschenbuch
Schlagwörter
CAD, integrated circuit, programming, Boolean algebra, algorithms, computer, logic, computer-aided design (CAD), verification, circuit design, automata
Thema-Inhalt
TJFC - Schaltkreise und Komponenten (Bauteile)
UY - Informatik
UYA - Theoretische Informatik
UGC - Computer-Aided Design (CAD)
THR - Elektrotechnik
PBD - Diskrete Mathematik
UYAM - Mathematik für Informatiker
UYQ - Künstliche Intelligenz
Inhaltsverzeichnis
I: Introduction.1. Introduction.2. A Quick Tour of Logic Synthesis with the Help of a Simple Example.- II: Two Level Logic Synthesis. 3. Boolean Algebras. 4. Synthesis of Two-Level Circuits. 5. Heuristic Minimization of Two-Level Circuits. 6. Binary Decision Diagrams (BDDs).- III: Models of Sequential Systems. 7. Models of Sequential Systems. 8. Synthesis and Verification of Finite State Machines. 9. Finite Automata. IV: Multilevel Logic Synthesis. 10. Multi-Level Logic Synthesis. 11. Multi-Level Minimization. 12. Automatic Test Generation for Combinational Circuits. 13. Technology Mapping. A. ASCII Codes. B. Supplementary Problems.- Bibliography.- Index.
Höhe
235 mm
Breite
15.5 cm
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