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Der Umwelt zuliebe

SystemVerilog for Verification

Chris Spear (Gebundene Ausgabe, Englisch)

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Beschreibung
This book provides practical information for hardware and software engineers using the SystemVerilog language to verify electronic designs. The authors explain methodology concepts for constructing testbenches that are modular and reusable. The text includes extensive coverage of the SystemVerilog 3.1a constructs, and reviews SystemVerilog 3.0 topics such as interfaces and data types. Included are detailed explanations of Object Oriented Programming and information on testbenches, multithreaded code, and interfacing to hardware designs.
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Technische Daten


Erscheinungsdatum
25.06.2007
Sprache
Englisch
EAN
9780387270364
Herausgeber
Springer US
Sonderedition
Nein
Autor
Chris Spear
Seitenanzahl
302
Auflage
1
Einbandart
Gebundene Ausgabe
Buch Untertitel
A Guide to Learning the Testbench Language Features
Schlagwörter
verification, communication, Software, Verilog, Interface, methodology concepts, Hardware, design, testbenches, SystemVerilog, Spear, programming, testing
Thema-Inhalt
TJFC - Schaltkreise und Komponenten (Bauteile) UGC - Computer-Aided Design (CAD) UK - Computerhardware THR - Elektrotechnik
Höhe
235 mm
Breite
15.5 cm

Warnhinweise und Sicherheitsinformationen

Informationen nach EU Data Act

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