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Logic Synthesis and Verification Algorithms
Gary D. Hachtel, Fabio Somenzi (Broschiert, Englisch)
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Beschreibung
Logic Synthesis and Verification Algorithms
is a textbook designed for courses on VLSI Logic Synthesis and Verification, Design Automation, CAD and advanced level discrete mathematics. It also serves as a basic reference work in design automation for both professionals and students.
Logic Synthesis and Verification Algorithms
is about the theoretical underpinnings of VLSI (Very Large Scale… Integrated Circuits). It combines and integrates modern developments in logic synthesis and formal verification with the more traditional matter of Switching and Finite Automata Theory. The book also provides background material on Boolean algebra and discrete mathematics.
A unique feature of this text is the large collection of solved problems.
Throughout the text the algorithms covered are the subject of one or more problems based on the use of available synthesis programs. 90,94 €
oder
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Du kannst wie immer einen Kaufalarm setzen, wenn du auf das gebrauchte Buch warten möchtest.
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Der Umwelt zuliebe
Technische Daten
Erscheinungsdatum
18.03.2013
Sprache
Englisch
EAN
9781475770360
Herausgeber
Springer US
Sonderedition
Nein
Autor
Gary D. Hachtel, Fabio Somenzi
Seitenanzahl
564
Auflage
1
Einbandart
Broschiert
Schlagwörter
Automat, Boolean algebra, VLSI, algorithms, automata, formal verification, logic, verification
Thema-Inhalt
TJFC - Schaltkreise und Komponenten (Bauteile)
UYA - Theoretische Informatik
THR - Elektrotechnik
UGC - Computer-Aided Design (CAD)
UYAM - Mathematik für Informatiker
PBD - Diskrete Mathematik
UYQ - Künstliche Intelligenz
Höhe
254 mm
Breite
17.8 cm
Hersteller: Springer Nature Customer Service Center GmbH, Europaplatz 3, Heidelberg, Deutschland, 69115, ProductSafety@springernature.com
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