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Writing Testbenches: Functional Verification of HDL Models
Janick Bergeron (Broschiert, Englisch)
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Beschreibung
mental improvements during the same period. What is clearly needed in verification techniques and technology is the equivalent of a synthesis productivity breakthrough. In the second edition of Writing Testbenches, Bergeron raises the verification level of abstraction by introducing coverage-driven constrained-random transaction-level self-checking testbenches all made possible through the… introduction of hardware verification languages (HVLs), such as e from Verisity and OpenVera from Synopsys. The state-of-art methodologies described in Writing Test benches will contribute greatly to the much-needed equivalent of a synthesis breakthrough in verification productivity. I not only highly recommend this book, but also I think it should be required reading by anyone involved in design and verification of today's ASIC, SoCs and systems. Harry Foster Chief Architect Verplex Systems, Inc. xviii Writing Testbenches: Functional Verification of HDL Models PREFACE If you survey hardware design groups, you will learn that between 60% and 80% of their effort is now dedicated to verification. Dieses Produkt haben wir gerade leider nicht auf Lager.
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Der Umwelt zuliebe
Technische Daten
Erscheinungsdatum
21.10.2012
Sprache
Englisch
EAN
9781461350125
Herausgeber
Springer US
Sonderedition
Nein
Autor
Janick Bergeron
Seitenanzahl
478
Auflage
2
Einbandart
Broschiert
Schlagwörter
Factor, Hardware, Hardwarebeschreibungssprache, Interface, Rack, Simulation, SoC, VHDL, Verilog, hardware verification, integrated circuit, model, modeling, programming, system on chip (SoC)
Thema-Inhalt
TJFC - Schaltkreise und Komponenten (Bauteile)
UMC - Compiler und Übersetzer
UYA - Theoretische Informatik
UGC - Computer-Aided Design (CAD)
UK - Computerhardware
THR - Elektrotechnik
Höhe
235 mm
Breite
15.5 cm
Hersteller: Springer Nature Customer Service Center GmbH, Europaplatz 3, Heidelberg, Deutschland, 69115, ProductSafety@springernature.com
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