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Beschreibung
Since register transfer level (RTL) design is less about being a bright engineer, and more about knowing the downstream implications of your work, this book explains the impact of design decisions taken that may give rise later in the product lifecycle to issues related to testability, data synchronization across clock domains, synthesizability, power consumption, routability, etc., all which are… a function of the way the RTL was originally written. Readers will benefit from a highly practical approach to the fundamentals of these topics, and will be given clear guidance regarding necessary safeguards to observe during RTL design. 96,29 €
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Technische Daten
Erscheinungsdatum
01.10.2014
Sprache
Englisch
Originalsprache
Englisch
EAN
9781489995452
Herausgeber
Springer US
Sonderedition
Nein
Autor
Sanjay Churiwala, Sapan Garg
Seitenanzahl
182
Einbandart
Broschiert
Buch Untertitel
A Practical Guide
Schlagwörter
Clock Domain Crossing, RTL Design, Static Timing Analysis, VLSI Design
Thema-Inhalt
TJFC - Schaltkreise und Komponenten (Bauteile)
UGC - Computer-Aided Design (CAD)
Höhe
235 mm
Breite
15.5 cm
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