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SystemVerilog for Verification
Chris Spear (Gebundene Ausgabe, Englisch)
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Beschreibung
The updated second edition of this book provides practical information for hardware and software engineers using the SystemVerilog language to verify electronic designs. The author explains methodology concepts for constructing testbenches that are modular and reusable. The book includes extensive coverage of the SystemVerilog 3.1a constructs such as classes, program blocks, randomization,… assertions, and functional coverage. This second edition contains a new chapter that covers programs and interfaces as well as chapters with updated information on directed testbench and OOP, layered, and random testbench for an ATM switch. Dieses Produkt haben wir gerade leider nicht auf Lager.
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Der Umwelt zuliebe
Technische Daten
Erscheinungsdatum
10.07.2008
Sprache
Englisch
EAN
9780387765297
Herausgeber
Springer US
Sonderedition
Nein
Autor
Chris Spear
Seitenanzahl
429
Auflage
2
Einbandart
Gebundene Ausgabe
Buch Untertitel
A Guide to Learning the Testbench Language Features
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